SAR ADC cap unit 2023-09-20

https://bbs.eetop.cn/thread-454033-1-1.html 按照 DNL 和 INL 定义计算相应的标准方差，二进制权重时： 单端结构： sigma(DNL)max= sqrt( ...

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CDAC+logic 2023-07-14

四、CDAC 1.Cap in CDAC sw_sp作为dac_cell_0的开关信号，控制dac_cap_0的C0x0.5(dummy)打开/关闭 sel<0>作为dac_cell_0的开关信号，控制dac_cap_0 ...

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SAR ADC Q&A 2023-06-26

1. clk_en 就是SOC ，更改相关verilog code 2. 2个analog input channel 变成6 个，包含t_sensor_dc  1. Missing code 解决思路 https://b ...

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PLL QA 2023-06-26

Q： 1.高数量的inv in ring oscillator 有什么优点？ 2.VCO的为什么选择source follower 结构？ 3.Ring oscillator 的duty cycle 误差大于5% 有什么问题？ ...

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To-do-list 2023/05/08 INL DNL 2023-05-08

1.Q:INL如何折算成THD? https://bbs.eetop.cn/thread-868234-2-1.html A:INL和THD的对应关系我也忘了在什么地方看到的了。 只是依稀记得，各level出现 ...

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To-do-list 20230321 SAR ADC研究 2023-03-22

To-do-list 20230321 文献： http://sci-hub.ee/ https://sci.bban.top/pdf/10.1109/ISVDAT.2015.7208139.pdf?download=true https://bbs.eetop.cn/forum.p ...

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