在前次的文章“ Latch up Rule 的难点”中,我们提到:为了解决 Latchup rule 中的隔离或者挡住问题,必须寻找一种方法:它可以把 2 个 layer 之间被隔离的图形准确找到。 如上图所示,在左上的 Nch Transistor W 200um ...
一 金属线是为了传输电流,因此主要需要从解决和减小它的(寄生)电阻、(寄 生)电容方面多做考虑。(寄生)电感一般忽略,高频电路除外。这主要从两个 方面分析解决: 1.电路方面 A、如果所用金属线,主要是流过电流(如电流镜MOS 管的漏极连线、功率MOS 管的漏极等)。在这种情况下金属连线的寄 ...
seal ring是什么 从 layout 角度看,seal ring是一个由diff, contact, via和metal等layer按照一定的规则叠加组成的图形。 从 工艺 角度看,seal ring是一种氧化、钝化层结构 从物理角度看,seal ring是介于芯片(chip)和划片槽(scrible line)之间的(保护)环。 seal ring怎么画 如果不想承担什么风险, 给芯 ...
电阻,电容,电感作为无源三兄弟是电路中最常见的结构,即便电路中没有使用这些器件,但是寄生电阻,寄生电容,寄生电感也会在电路中无处不在。电容相较于电感在电路中更为常见,而且有些特殊的模拟IC需要使用电容进行隔离,所以这期重点讲下电容。(专门在电路中使用电感的情况,作者还是比较少见的) 常见的电容主要有 ...
tsmc:PSUB2 = smic:SUBD tsmc:NTN = smic:PSUB ① tsmc里面叫PSUB2,smic 叫SUBD,作用就是区分各个gnd,使得lvs 通过,是non mask layer,和mask制作无关,只是让lvs通过。 psub2是虚拟衬底隔离,只是方便LVS识别不同名称的衬底,对实际制版和生产没有影响。 ② tsmc里面叫NTN,smic叫PSUB,NT_N叫Native NMOS ...
答案是: 可以。 估计这个问题拿去问analog designer,90%的人会说不可以。 这个问题更严格的提一下,就是一个环路,dc时增益1( 0dB),相位为0(有的仿真器默认加了一个负号,所以那里就是180度)这个系统能稳定存在吗? 一个很trival的答案是pll。做pll的人会发现,这就是pll的环路特性。由于dc点的双极点,导致了这 ...
之前写过一篇关于自己走上IC设计道路的小短文,大概讲述了自己“学艺”这几年的一些经历和感受。到今年7月自己已经工作整整8年了。熬过了IC行业的不景气时代,这两年的蒸蒸日上却让我很多次有种要跳出这个“舒适”圈的感觉。实话讲不是对这个行业的厌倦,可能是对自己生 ...
FPGA(现场可编程门阵列)是一种可重构的微芯片——已经被证明可以运行一款用C语言编写的3D光线追踪游戏,其效率是x86 CPU的50倍,而功耗仅为后者的2%,这可能为未来编程效率的提高指明了道路。 这是由来自阿根廷的开发人员Victor Suarez Rovere和来自宾夕法尼亚州的系统工程师Julian Kemmerer所完成的,文末可以 ...
后仿 1 、抽寄生参数 在进行寄生参数抽取之前需要阅读后抽的文件并进行一定的调整,抽取的文件在工艺文件的LVS文件夹下面(提前拷贝到自己的 ...
作者:张倩忆,沈龙 Cadence 楷登 文末可申请PPT资料 早期集成电路设计中,工程师考虑的信号延迟主要产自于标准单元自身的延迟。然而从业界的主流工艺进入深亚微米之后: 绕线产生的信号延迟在总占比上越来越大 信号噪声对于芯片功能的影响也不断增加 ...
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