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- HSIO Tips Part3 2015-11-10
- 目前 FPGA 高速应用越来越多，速率也越来越高，替换了很多早期 FPGA+ 分离 SERDES 的方案，那么高速传输的关键技术有哪些呢？这里最重要的是 TX 端的预加重（ ...
- 时钟管理单元 2014-12-23
- 把握DCM、PLL、PMCD和MMCM知识是稳健可靠的时钟设计策略的基础。赛灵思在其FPGA中提供了丰富的时钟资源，大多数设计人员在他们的FPGA设计中或多或少都会用到。 ...
- FPGA的DCI技术 2014-12-18
- Xilinx 系列 FPGA 的 DCI 技术 1、 DCI 技术概述 随着 FPGA 芯片越大而且系统时钟越高， PCB 板设计以及结构设 ...
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- 关于Tab 键 在ultraedit及modelsim的使用问题 2014-12-17
- 1.ultraedit中点 高级-〉配置-〉左边树形菜单-〉展开编辑器-〉自动换行/制表符设置 在后边就可以任意设置要想要的了 你说的格数应该是 缩进格数 你只用将 缩 ...
- ram使用说 2014-11-25
- 应用平台vivado 1、当No primitives output register and No core output register时，读出的数据与读地址和读使能相差1个读时钟周期。此时读使能失效后会 ...
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