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alex_fd12 2025-8-4 11:30
本帖最后由 fatcat1205 于 2025-8-3 07:43 编辑 config是通过文本CellView中的pc.db文件来获得该文本文件中定义的module所包含的例化器件。 而pc.db则是在Virtuoso Text Editor中编译该文本文件中产生的。我忘了Virtuoso文本编译器是怎么处理generate中利用For语句来例化的器件。 我的做法是直接不在Config中做相应设置。直接将对用的Verilog模块绑定成Symbol。然后将该verilog模块和generate中例化器件的源代码作为xrun的参数，它们会被编译到worklib中。这样Elaboration过程中就能找到了。 P.S，规范的操作是将veri ... ...
Gwyzlz 2024-10-11 16:28
请问这个noise_typical noise_worst这个工艺角该怎么设置啊
灯火 2021-11-17 14:52
您好，2016年您发过一个帖子，讨论关于PA的输出耦合到VCO输出，请问最后怎么减小这个耦合的？谢谢！
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