日志

分享 VMware6.5 下的RHEL4 AS 安装关键过程

2013-4-7 14:05

1.安装RHElinux4过程中提示插入disk3时出错，不妨可以更换一个CDrom加载。菜单栏VM--removable...--cd/dvd2。 2.打开系统，安装VMwareTools，在桌面Computer文件夹下，双击相应的图标即可，前提是把tool的iso文件加载到虚拟的光驱里面。 3.安装Vmware Tools。 VMware Tools是VMware虚拟机中自带的一 ...

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分享 什么是亚稳态

2013-4-2 12:34

亚稳态 是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入 亚稳态 时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去。 1． ...

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分享 DC简明教程

2013-4-2 11:28

1.1 什么是 DC? DC(Design Compiler) 是 Synopsys 的 logical synthesis 优化工具，它根据 design description 和 constraints 自动综合出一个优化了的门级电路。它可以接受多种输入格式，如硬件描述语言、原理图和 netlist 等，并产生多种性能报告，在缩短设计时间的同时提高读者设计性能。 1.2 ...

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分享 SI信号完整性分析术语(转)

2013-4-2 11:27

1、什么是信号完整性（Singnal Integrity）？ 信号完整性（Singnal Integrity）是指一个信号在电路中产生正确的相应的能力。信号具有良好的信号完整性（Singnal Integrity）是指当在需要的时候，具有所必须达到的电压电平数值。主要的信号完整性问题包括反射、振荡、地弹、串扰等。常见信号完整性问题及解决方法： 问题 ...

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分享 关于IC职业选择的建议

2013-4-2 11:25

发信人: toctory (欢迎来到地球), 信区: METech 标 题: 关于职业选择的建议 发信站: 水木社区 (Thu May 17 00:59:44 2012), 站内 欢迎转载，但请尊重原创。请注明转自METech of SMTH. 首先，拜天朝的教育制度和独生子女政策导致的父母过度包办人生道路所致，现在很多同学们都是没搞明白自己要干什么的时候，就已经走上 ...

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分享 ASIC/SoC后端设计作业流程剖析

2013-4-2 09:06

Toshiba(美国) 秦晓凌 Trident( 上海 ) 潘中平 关键词 place route DSM megacell clock_tree STA OPT ECO 引言 众所周知,ASIC产品是从用硬件描述语言( verilog HDL,VHDL)开始进行数字逻辑 电路 设计的,经过相关的 仿真 、综合出门级网表、验证直至完成电路布局布线并优化,最终经流片成功形成的 ...

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分享 StarRC 抽取门级spef文件

2013-4-1 16:57

使用starRC抽取门级spef文件,首先需要nxgrd文件,有的厂家只提供.itf文件,那么需要自己动手转换,如果机器上装了starRC工具,使用如下命令: grdgenxo ****.itf 不过这个过程需要比较长的时间 ,自动会生成****.nxtgrd, 有时候会遇见自己用的starRC的版本比厂家提供的nxtgrd比较老,那么就会报错,这是也需要自己转换,生 ...

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分享 用skill导出PAD的封装信息

2013-4-1 16:55

在做完芯片的版图之后,就要考虑芯片的封装,封装则需要后端工程师提供以下信息: 1. 芯片die的面积 2.芯片的PAD分布图,也就是各个PAD 的name 3.芯片PAD的坐标位置 printf("\nBondingPadLabel()\n") procedure(BondingPadLabel() cvId=getEditRep(hiGetCurentWindow()) foreach(shape cvId~shapes while((strcm ...

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