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分享 ncverilog常用命令使用详解: mafan88 2012-2-10 17:26; 我们知道，由于NC-Verilog使用了Native Compile Code 的技术来加强电路模拟的效率，因此在进行模拟时必须经过compile(ncvlog 命令）以及elaborate(ncelab命令）的步骤。编译之后，针对每一个HDL设计单元会产生中间表达。接着elaborate命令会建立整个电路的结构，产生可以用来模拟的资料。最后使用nc ...; 个人分类: IC设计|3872 次阅读|0 个评论

分享项目总结: mafan88 2012-2-10 13:36; 又做完一个项目，更加熟悉IC设计的流程，但是在整个项目过程中，还是忽视了几个重要的地方。 1.综合工具报告中的warning，由于系统过于庞大，忽视了dc报告中的warning，从warning中可以找到许多设计中存在的问题。; 个人分类: IC设计|195 次阅读|0 个评论

分享 SRAM操作一点通: mafan88 2012-2-2 17:57; 转载 SRAM 操作一点通最近操作了诸如 UT62256,GM76C256,IS61LV5128 等 SRAM 芯片，基本上他们的时序操作大同小异，在这里总结一些它们共性的东西，也提一些简单的快速操作 SRAM 的技巧。这里就拿刚用着的 IS61LV5128 说吧，它的管脚分配如 ...; 个人分类: IC设计|1401 次阅读|2 个评论

分享基于FPGA的跨时钟域信号处理: mafan88 2012-1-30 10:24; 基于 FPGA 的跨时钟域信号处理——专用握手信号在逻辑设计领域，只涉及单个时钟域的设计并不多。尤其对于一些复杂的应用， FPGA 往往需要和多个时钟域的信号进行通信。异步时钟域所涉及的两个时钟之间可能存在相位差，也可能没有任何频率关系，即通常所说的不同频不同 ...; 个人分类: IC设计|235 次阅读|0 个评论

分享 latch的好处坏处总结: mafan88 2012-1-11 21:11; 1. latch是电平触发，无法实现同步操作，与我们正常的时序逻辑电路设计思路不符。 2. latch会对输入电平敏感，受布线延迟影响较大，比较容易导致输出有毛刺产生。 3. latch会导致静态时序分析和DFT会很复杂。 4. 在ASIC中使用latch的集成度比DFF高，但在FPGA中正好相反，因为FPGA中没有标准的latch单元，但有DFF单元，一 ...; 个人分类: IC设计|5058 次阅读|0 个评论

分享流程(Verilog/Modelsim+Debussy): mafan88 2011-12-22 17:56; 收藏仿真工作流程(Verilog/Modelsim+Debussy) 转载：http://bbs.ednchina.com/BLOG_ARTICLE_29473.HTM 这是献给大家的第二篇，文章详细说明了本人近一年来，自己摸索出来的一套仿真工作流程。接触过Modelsim这类软件的朋友可能都会感觉上手比较困难，原因有二：一、对仿真机制不了解，对基于sourc ...; 个人分类: IC设计|2954 次阅读|0 个评论

分享文件读写 %fdisplay %readmem: mafan88 2011-11-21 13:29; 文件读写 %fdisplay %readmem 默认分类 2009-12-16 16:54:07 阅读 123 评论 0 字号：大中小系统函数＄fopen用于打开一个文件，并还回一个整数指针．然后，＄fdisplay就可以使用这个文件指针在文件中写入信息，写完后，则可以使用＄fclose系统关闭这个文件例如 ...; 个人分类: IC设计|4412 次阅读|0 个评论

分享 Quartus笔记3—— 复位设计: mafan88 2011-9-19 19:03; Quartus笔记3—— 复位设计本篇大部分内容参考了其他网友的内容，因为在设计中 ...; 个人分类: IC设计|950 次阅读|0 个评论

分享关于encoder设计的几点疑问: mafan88 2011-7-28 10:45; 1.在测试FPGA视频输出时，应用PCI扩展版和原始输出口的区别？ pci的电路走线比fpga板上的好，可以测出更好的视频指标。 PCI扩展版上采用了4个dac900e的dac芯片，和fms6143的three-channel 4th-order standard definition video filter. ...; 个人分类: IC设计|158 次阅读|0 个评论

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