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分享 积极应对半导体测试挑战 加速科技助力行业“芯”升级
杭州加速科技 2024-4-26 17:36
在全球半导体产业高速发展的今天,中国“芯”正迎来前所未有的发展机遇。AI、5G、物联网、自动驾驶、元宇宙、智慧城市等终端应用方兴未艾,为测试行业带来新的市场规模突破点,成为测试设备未来重要的增量市场。新兴领域芯片产品性能不断提升、使用场景也更加苛刻,对于芯片的设计和测试都提出了新的挑战,同时也带来了新 ...
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分享 NTO常规流程
jason.aliang 2024-4-26 16:30
NTO一般12片wafer, 3片wafer out(做完) 6片停到M1(M1不做) 3片停到AA(AA不做)(AA-M1 前端制程)(Metal via 后端制程) cp (探针测试) FT (封装测试) HTOL (可靠性测试)
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分享 模拟电路分类及各类型电路版图注意事项
cj_181888888 2024-4-26 13:35
集成电路 (一)模拟集成电路的分类(按频率和功能) 1.按频率分类: 按照被处理信号的频率来分类,在设计时有时虽然频率的位数只增加1位,但电路的设计方法与低频电路的设计方法完全不同。 (1)低频模拟集成电路 (2)高频模拟集成电路 (3)射频模拟集成电路(RF:radio frequency) 2.按使用功能分类: (1 ...
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分享 批量删除后缀前缀,添加前缀后缀
模拟后端的小白 2024-4-26 11:08
#!/bin/bash for file in `\ls -d *` do mv $file 前缀_{file}_后缀 rename 前缀或者后缀 ' ' ./* ;用空格来替代 前缀或者后缀 ./*代表当前目录地方所有文 ...
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分享 什么命令能把两个GDS快速merge到一起
cj_181888888 2024-4-26 10:30
试试calibre drv 在terminal中输入calibredrv -shell,然后输入下面的命令 layout filemerge -in dummy.gds -in original.gds -out final.gds -createtop TOP -in指定要merge的gds文件 -out指定merge后的gds文件 -createtop指定merge后gds中的顶层单元
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分享 模拟IC设计面试中,针对离散时间sigma delta ADC,在面试时面试官会问些什么问题?(各 ...
zhaowell 2024-4-25 18:39
模拟IC设计面试中,针对离散时间sigma delta ADC,在面试时面试官会问些什么问题?(各位大佬可以留下问题和解答吗)
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分享 双极型晶体管
teresa_xie 2024-4-25 17:27
双极型晶体管的基本结构--BJT Bipolar Junction Transistor NPN型三极管的结构 N:集电极C,集电区与基区的较大接触面积,掺杂浓度最低; P:基级B,基区薄,掺杂 ...
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分享 使用EDIF In创建数字库的symbol
metotj 2024-4-25 16:06
当foundry提供的数字库没有symbol的时候,有时候会提供symbol的EDIF文件,这时候就需要用到Virtuoso的EDIF in功能,截图如下,可参考。
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分享 找出文件夹下的子文件中是否有指定关键词
18222691126 2024-4-24 20:35
find . -name *.log (找出当前文件夹下包含xx.log的文件) find . -name *.log | xargs grep violation (在这些文件中找包含violation的关键词) ...
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分享 全新低功耗中端Avant FPGA,LAV-AT-E30-1ASG410C、LAV-AT-E70-3CBG484C、LAV-AT-E70-1 ...
mjd888 2024-4-24 15:27
网络边缘的FPGA创新:Avant-E FPGA专为网络边缘处理而生 说明:Avant-E FPGA器件旨在解决客户在网络边缘面临的一些关键挑战。该系列是基于16nm FinFET工艺构建的产品,拥有低功耗、小尺寸和高性能以及针对数据处理和AI等网络边缘应用需求量身定制的优化功能集。 Avant-E系列可提供中端FPGA中极高的DSP和存储逻辑比, ...
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