http://www.edaboard.com/thread63856.html The historical use of Tie-Lo and Tie-Hi cells is almost as much emotional as it is secular. The reason I say this is that some people use them religiously without thought as to why. Depending on your process and your design they may or may not be n ...
上一篇里说小信号模型,其实漏了电容,所以只是一个直流小信号模型。要讨论交流信号的传输,就离不开电容(在一般的模拟电路设计中,电感出现的概率太小)。 其实对于电容,说起来也好理解,也不好理解。通常在饱和区,大家都知道有cgs,cgd,等等,而每个电容里都包括覆盖电容和本征电容,覆盖电容是由于加工造成的寄生性 ...
1.Capacitorsandresistorshaveparasiticinductance,about0.4nHforsurfacemountand4nHforaleadedcomponent. 1. 电阻跟电容都有寄生电感,贴片封装的大概 0.4nH ,插件的大概 4nH. 2 ...
OTA, 是运算跨导放大器。输入是电压信号,输出为电流信号。因此,理想的OTA输入阻抗为无穷大,输出阻抗也为无穷大。由于输出阻抗很大,所以只能驱动容性负载。 opa mp,输入,输出都是电压信号。理想的 opa mp,输入阻抗无穷大,输出阻抗为零。可以驱动阻性,容性负载。 在很多的时候,并没有很刻意的区别这两 ...
如果所有的mos都在饱和区遵守I=1/2u*cox*w/L*(vgs-vth)^2这个公式,也许天下太平,模拟工程师就可以和数字工程师一样直接写代码,一天做成百上千个opa了,spice也没人要了,bsim小组也可以解散了。 可惜事实不是这样。先说最基本的修正吧。上面公式里就没有vds的影响,等效r0无穷大。现实中最早就修正了(1+lamda*vds ...
如果从1999年7月开始用spice给老师跑仿真,画版图算起,进入IC设计已经十多年了。这期间做过的电路类型有读出电路,有delta-sigmaAD/DA,有pll,dll,有高速IO,帮人调试过的电路也有一些。当然感兴趣想做而未作的电路更多了。从预研,电路设计,版图,测试,基本可以算作一个反馈过程。那么这个反馈应该也经历了很多次了 ...
规范很重要 工作过的朋友肯定知道,公司里是很强调规范的,特别是对于大的设计(无论软件 还是硬件),不按照规范走几乎是不可实现的。逻辑设计也是这样:如果不按规范做的 话,过一个月后调试时发现有错,回头再看自己写的代码,估计很多信号功能都忘了, 更不要说检错了;如果一个项目做了一半一个人 ...
timing window。 2010-06-17 10:05 最近在看signal integrity相关内容,老是被一些专有名词所纠缠 比如 timing window 、 timing window width The effect of crosstalk between two nets depends largely on the overlap of timing windows between the two nets. Timing windows at a pa ...
电迁移 EM(electromigration) 电迁移(EM)是微电子器件中主要的失效机理之一,电迁移造成金属化的开路和短路,使器件漏电流增加。在器件向亚微米、深亚微米发展后,金属线的宽度不断减小,电流密度不断增加,更易于因电迁移而失效。因此,随着工艺的进步,EM的评价备受重视。 导致电迁移的直接原因 ...
说来惭愧,我所了解的牛人也只是大学教授,工业界的高手了解的还太少,虽然我对教育界的牛人了解的也不多,但这里也要牢骚几句,论坛上的人好像只是认识 Gray, Razavi, Allen, Lee, 要不是 THU 用 Sansen 的书估计大家还不知道有 sansen 这号人吧,其实不要只盯着 Berkley,Stanford,UCLA, 大家也应 ...
hebut_wolf
大智慧lcy
teresa_xie
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杭州加速科技
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