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Design Rule 相关介绍 2011-03-07
Design Rule 相关介绍 本篇介绍的design rule只针对 CMOS 技术。画版图时需要按design rule的要求来操作，所以 也就有我们常提到的DRC（design rule check）， ...
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如何成为一位杰出的工程师 (How to be a Star Engineer ) 2011-02-25
Robert E. Kelley, Carnegie Mellon University (Robert E. Kelley, "How to be a star engineer," IEEE Spectrum, pp. 51-58, Oct. 1999.) ...
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Calibre经典教程和看LVS的错误报告的方法[二] 2011-02-24
5 ． Report 中最重要的部分―― INCORRECT NETS 部分：        Report 中， ...
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学verilog的可以好好看看！ 2010-05-24
规范很重要 工作过的朋友肯定知道，公司里是很强调规范的，特别是对于大的设计（无论软件还是硬件），不按照规范走几乎是不可实现的。逻辑设计也是 ...
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RTL设计推荐的各步骤 推荐工具 适合VHDL verilog 2010-05-24
初学EDA时候，大家都在找工具而烦恼，有些工具不是没有license 就是不会设置，要不就是不会用，还担心这个以后有人用么？      所以，我 ...
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照亮我的月亮 2025-9-17 14:42
您好 ，我想将您这个转载到别的地方，会带这个原链接，如果您不同意请联系我哈 谢谢
sgj821 2020-4-10 11:08
哈喽，请问你现在有DDR phy 的相关资料吗
madson 2013-4-24 22:08
missing port可能是什么原因？我要修改工艺规则文件
chengru1026 2011-12-12 17:09
你好，看来你是这方面的高手啊，我是刚学的，请问一个24进制的计数器（0-23计数），系统的输入是rst,clk,输出是q1[3:0],q0[3:0]分别显示个位和十位的数据！这个怎么写啊
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