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- 吴小呆
- 版图自动布线
layout版图Assistant工具自动布线使用教程
https://bbs.eetop.cn/thread-970209-1-1.html
(出处: EETOP 创芯网论坛 (原名：电子顶级开发网))
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- 吴小呆
- 版图小技巧
1.
在你重叠的地方右键一下,点击(De)Select Under Cursor, 会得到这个地方存在的所有能选择的层或者instant,你可以自由选择你要的东西,如果需要多选,可以点击这条虚线,选择框就会独立出来,就可以多选了。
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- 吴小呆
- 芯片的ref是什么意思
这表示"参考电流",ref是"reference"的缩写。
一般来说,芯片都有Vref、Fref和lref,分别代表参考电压、参考频率(时钟)和参考电流。这是因为芯片往往是根据一个参照物来决定其输出及作出逻辑判断的。这些ref正是参照点。
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- 吴小呆
- 问题：像这种space改不了，能删了shielding线吗？
电源地可以充当shielding
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- 吴小呆
- DHJOA
LHIOA mbist
DDCPB CPB芯片 AMP
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- 吴小呆
- 例：只想运行检查M1的DRC
* DRC
Rules - Check Selection Recipe 点击Edit... - include 勾选None - 右侧勾选M1
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- 吴小呆
- 通过log查找之前的版本,并且找到人
Show Save Log
* terminal
通过ypcat passwd grep***(*代指用户名)
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- 吴小呆
- 克隆 ：相同器件（类型，连线关系）进行克隆
*工具栏（下面最后一排 第三个）
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- 吴小呆
- 初始系统密码更改命令为yppasswd
* terminal
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- 吴小呆
- 在 CIW窗口输入以下命令 取消高亮
geDeleteAllHilightSet(geGetEditCellView())
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- 吴小呆
- 重新登陆
1. 端口 NoMachine 或者 VNC
2. 服务器登陆，登录不了，需要IP地址（IP地址查找：Win+R，打开cmd,输入ipconfig）
3. 输入账号和密码
4. 已进入，设置页面，System – Preferences – Display 最大尺度
5. 打开terminal
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- 吴小呆
- 1.打开路径找到自己库里新建文件夹命名为LVL，在LVL下新建文件夹命名为A（cell的名字）
2.新路径 -/-/-ver-drc-原始库-A-将A.gds拖到路径1的A里面，更改名字为A_org.gds,在更换路径drc-正在编辑中的A库-A.gds拖到路径1的A里面
3.在LVL下打开terminal,输入代码即可完成
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- 吴小呆
- 问题：查看版图密度
*layout 工具栏
Tools - Area and Density Calculator... -
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- 吴小呆
- 添加金属线A_trk/A_mark
补密度问题，且金属A_trk可以通过隔断A_prohibit_cmp，但是在隔断层不发生。A_mark后期通过脚本会生成A pin，，形成A_drawing且连接到Power
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- 吴小呆
- 问题：使用stdcell等原理图，只能检查短路
* Virtuoso/File/Export/CDL - 选择stdcell - LVS/Inputs/netlist 取消勾选电路，选择对应路径/名字/库名
问题：查看 " *TOP.lvs.report.shorts" file.
* terminal
cd (LVS/Rules/LVS Run Directory 的路径） - gvim / gedit *TOP.lvs.report.shorts 查看
目的：顶层检查短路，LVS运行慢，使用简单电路运行LVS，只检查短路部分
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- 吴小呆
- 问题：图太大，验证LVS很慢，开启另一个terminal 不影响进程
* terminal
terminal敲： bhosts - 回车 - bsub -q nano xterm - 回车进入另一个
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