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Fantom_Ya 2021-11-15 17:20
IC新手: write_sdf -mode timesim -force -quiet ./$PROJECT/postsim_lib/post_sim.sdf
write_verilog -mode timesim -sdf_anno true -force ./$PROJECT/postsim_lib/pos ...
我之前用ise和vivado都是只用sdf和v的,没用到edf
直接用vcs加载就行了。
自己的工程没必要生成edf吧?
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