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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

日志

分享针对verilog 编写的VIM 函数: yuanqui_cn 2014-12-17 07:21; 在vim写verilog代码时，经常一些重复操作，所以自己写了一些vim 脚本函数，实现自动。 //左边为原始内容，后边为函数执行后内容。 //--------------------------------------------------------functions //列递增修改， ColInc(StartNum,LoopNum,StepNum,SkipLineNum,LoopNum) &n ...; 个人分类: viml|2022 次阅读|0 个评论

分享查看chipscope的波形文件: yuanqui_cn 2014-12-12 21:24; 查看chipscope的波形文件 chipscope采集波形回来以后，信号数量少的波形，还是很好查看和检查波形，可是如果信号数量多的话，操作不方便，相比仿真环境下的debussy(novas)差太多了。能用debussy(novas)直接看吗？在eetop,有很多同学用了各种方法：同学catcat_2回答：然后用modelsim, 有个命令叫vcd2wlf; vcd2wlf ...; 个人分类: debussy|4633 次阅读|0 个评论

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