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日志

Altera| modelsim| Xilinx|

分享 ISE增量编译: flyboy 2014-12-3 16:12; 附件纪录了ISE如何设置增量编译的。文件: ISE增量编译.pdf; 个人分类: Xilinx|903 次阅读|0 个评论

分享 ISE增量编译: flyboy 2014-12-3 16:09; 大型的设计或时序关键性模块的编译时间往往比较长，在常规的设计流程中，设计中任何小的改动都将需要对整个设计重新执行一遍编译、综合、布局布线等步骤，所以效率比较低。为解决这个问题，”赛灵思提出了partition和smart guide编译技术用来提高设计效率，可能很多朋友都没有注意到这两个工具，但使用 ...; 个人分类: Xilinx|10714 次阅读|5 个评论热度 1

分享 Modelsim 仿真时如何清晰查信号: flyboy 2014-12-2 15:12; Modelsim仿真时如果信号太多，不方便查找信号，那么我们不妨把信号做一下处理。一、加入分隔符语法：add wave -noupdate -divider -heightxxx yyy 其中xxx为数字，表示分隔符的高度，yyy为分隔符上出现的名字，比如input signals等 example: add wave -noupdate -divider -height 30 {import ...; 个人分类: modelsim|2906 次阅读|0 个评论

分享 Altera PLL 四种模式: flyboy 2014-12-1 17:47; Altera FPGA PLL 四种模式 PLL 共有四种工作模式，只有理解了这四种工作模式的特点，才能在设计中选用恰当的模式，完成自己设计的预期功能。这四种工作模式分别是普通模式（ Normal Mode ）、零延迟缓冲模式（ Zero Delay Buffer Mode ）、非补偿模式（ No Compensation Mode ）、源同步模式（ Source-Synchrono ...; 个人分类: Altera|8404 次阅读|2 个评论

分享 Altera fpga configuration process: flyboy 2014-12-1 16:05; this is the document which describe process of Altera fpga configuration. 文件: Configuring Altera FPGAs.pdf; 个人分类: Altera|975 次阅读|0 个评论

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