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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

日志

运放| DLL| ADC| Hspice| IO| ADEXL Cadence| matlab| 基准| 其他| 故事| PLL|

分享 L、C对运放AC分析的辅助作用：LoopGain、StageGain: chen_ww1993 2023-7-16 17:50; stb分析可以得到环路增益的bode图，但却不能看到环路中其他位置的AC增益大小，这在需要分析不同级的放大倍数时造成了困难。解决这个问题，可以按照下图所示的方法设计testbench。图1 以图1a为例，对环路断环进行仿真时，除了用stb分析方式之外，可以用如图1b所示添加L、C的办法进行环路增益仿真。L的作用是通 ...; 个人分类: 运放|305 次阅读|0 个评论热度 1

分享运放LoopGain的手动分析技巧: chen_ww1993 2023-7-8 11:56; 这一篇文章我们主要看下OP闭环电路小信号分析中常见的问题。有时候我们发现stb分析（β=1）的bode图和开环AC仿真的曲线相差很大，且两者的零极点位置、裕度等可能大有不同。探究造成该问题的原因，很有可能是我们在AC开环分析时没有计入反馈元件和输入级寄生电容的影响。更多文章内容，可关注“模拟小笨蛋”微信公众号， ...; 个人分类: 运放|366 次阅读|0 个评论

分享手动分析CMFB负反馈环路稳定性的技巧: chen_ww1993 2023-7-8 11:36; 我们都知道，全差分运放一般都有共模反馈电路（CMFB）,它的目的是稳定对称两点位置的共模电位。 CMFB一般也是通过负反馈方式来稳定共模点的，所以和主运放追求环路稳定性一样，CMFB环路也要考虑环路的稳定性。在电路仿真时，大家都用spectre的stb分析来进行辅助验证。但根据我和众多工程师的交流经验，大部分人其 ...; 个人分类: 运放|942 次阅读|0 个评论热度 7

分享一篇关于Analog IC中失调的总结性文章：以运放为例: chen_ww1993 2023-7-8 11:23; 一篇关于Analog IC中失调的总结性文章：以运放为例前言最近这段时间一直在负责某个项目的debug工作，其中一个问题的核心原因是接收电路的输入失调电压过大造成，该接收电路是以op为核心器件构建的信号链电路，负责对信号进行放大、均衡等。这次debug经历对失调影响有了更深入的理解。这篇文章重新梳理了一下我对失调的 ...; 个人分类: 运放|2624 次阅读|6 个评论热度 25

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