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IC新手 2021-11-13 15:18: write_sdf -mode timesim -force -quiet ./$PROJECT/postsim_lib/post_sim.sdf
write_verilog -mode timesim -sdf_anno true -force ./$PROJECT/postsim_lib/post_sim.v
您好，请问后仿只需要使用post_sim.v 与post_sim.sdf吗，网标edf文件需要吗

Fantom_Ya

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