高速先生成员:黄刚 就在刚刚,雷豹把他对叠层的调整方式和改善后的仿真结果给师傅Chris看完后,Chris给雷豹点了个大大的赞,因为优化的方式其实不需要大改DDR的走线,只需要把相邻层的信号最大限度的拉开,同时为了保证叠层厚度不变,就需要把信号和参考的地平面相应的靠近。这个操作的好处是显而易见,信号与信号 ...
有时候我们的schematic会被lock锁住,解锁的方法就是在schematic的路径下删除.cdslck尾缀的文件: Linux下删除cdslck文件:find-nameapos;*.cdslckapos;|xargsrm?rf
第一次打开toplevel.scs只有top_tt这一个Corner的section。其他的工艺角和MC都需要自己添加: 去看了TSMC65nm的文件,是包含其他的: 根据top_tt的section,模仿着加入后,还是会报错。原因是fs和sf的include的文件里面电容电感和电阻没有fs和sf,所以改用tt的: 完整的toplevel.scs应该如下: ...
经常需要理想的verilogA搭建的模块,有时候cds.lib没有加载理想模块ahdlLib库。其路径在/opt/eda/cadence/IC617/tools/dfII/samples/artist下: 直接用DEFINE ahdlLib $CDSHOME/tools/dfII//samples/artist/ahdlLib加到cds.lib中: 然后就有了:
半导体技术持续更新迭代,MCU也在与时俱进,为了更好地迎接市场未来趋势,国产MCU厂商积极布局各系列MCU产品线,开始逐渐在特定细分领域实现突破。随着应用场景的进化升级,MCU 中包含越来越多的功能模块,相应地,MCU全覆盖测试也越来越重要。如何高效地进行测试量产,快速定位芯片失效问题并进行质量把控,降低测试成本 ...
2331813-3边缘板连接器(0.60mm)间距,20682-040E-02 直角、40 位置 插座 连接器 — 明佳达 (1)连接器名称:2331813-3 详细描述:84 位置 母头 连接器 非指定 - 双边 镀金 0.024(0.60mm) 黑色 卡类型:非指定 - 双边 公母:母头 针位/格/排数:28; 14 针位数:84 卡厚度:0.062(1.57mm) ...
Keypoint: 一般关系是特征阻抗随着宽度的增加而下降。 《微波工程》上面的公式是 在《射频电路设计-理论与应用》上面的公式是 d或h是衬底厚度,这个一般在100um左右,线宽基本是小于这个值的,w/h1。 对于8h/w+w/4h这个对钩函数,第一象限的顶点在sqrt(32)*h (x+a/x, sqrt(a)), wh,所以会随着w的 ...
添加别人库的方式 ①library manager→edit→librarypath→edit→add library ②通过terminal指令:cd virtuoso/→cds.lib 打开的文件:DEFINE 名字/路径→保存→在library manager中vie ...
加载工具 mav —— 列出工具版本列表 ma —— 加载工具
https://mp.weixin.qq.com/s/izfz2LY_pQGAhS0dGJP3vA 我在最近的几篇文章里一直用到“民粹”(Populism)这个概念,因此觉得有必要厘清一下关于“民粹”的几个问题。 解释“民粹”并不是件容易的事,这个术语迄今为止都没有一个能够令所有人信服的精准定义。由于这个词在最近的几十年被大量地使用, “民粹 ...
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