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- 回复 fangtaocome
- 你斩波用的时钟，通过寄生电容馈通过去的，后仿比前仿的寄生电容大，耦合过去的幅度就大了
- 回复 gtfei
- 从每个小台阶波形的变化斜率上看起来，带宽是够的，时钟馈通后运放是能自己拉回来的，不排除输入信号被馈通的情况。
fangtaocome: 你斩波用的时钟，通过寄生电容馈通过去的，后仿比前仿的寄生电容大，耦合过去的幅度就大了
另外还得查一下版图匹配性，有可能是后仿的运放走线有问题，引入了offset，chopper在处理这个offset，形成了一上一下的输出，大致看起来均值是恒定的，没啥大问题。
- 回复 再美也美不过想
- 感谢您的回答，版图匹配性我能理解，那么关于输入信号被馈通的情况，我的tesbench是电阻负反馈10倍反向放大输入信号，用port给的sine信号，瞬态确实可以看出输入信号也被馈通了一些，但也能拉回去，而且馈通的幅值很小。如果输入信号馈通也能拉回去应该就不是影响后仿的原因吧？
gtfei: 从每个小台阶波形的变化斜率上看起来，带宽是够的，时钟馈通后运放是能自己拉回来的，不排除输入信号被馈通的情况。
另外还得查一下版图匹配性，有可能是后仿的 ...
- 回复 gtfei
- 输入信号被馈通chop是消不了的，因为你不清楚正反周期馈通的量是否相等，能否完全抵消，况且每半个周期输入电压还是在不断变化。
再美也美不过想: 感谢您的回答，版图匹配性我能理解，那么关于输入信号被馈通的情况，我的tesbench是电阻负反馈10倍反向放大输入信号，用port给的sine信号，瞬态确实可以看出输入 ...
如果输入信号的驱动能力很强可以不用考虑馈通对它的影响，一方面前级驱动自己能稳住，另一方面影响确实小。
主要还是按照mismatch和走线不对称引入的offset去考虑，你的chop已经起作用了，你可仿真输出DC信号，运放接成比例放大，看一下是否每半个周期，输出信号仍“一上一下”，再看一下输出的平均值，没有太大偏差就代表chop是有用的。
然后去版图找可能导致运放差分通路不对称的地方，优化一下就好了。
- 回复 再美也美不过想
- 嗯，我明白您的意思了。我有单独仿真直流情况，输出平均值偏差很小。
gtfei: 输入信号被馈通chop是消不了的，因为你不清楚正反周期馈通的量是否相等，能否完全抵消，况且每半个周期输入电压还是在不断变化。
如果输入信号的驱动能力很强可 ...
关于版图，我的斩波开关和输入对管都很注重匹配，输入对管做了交叉匹配，电流镜也加了dummy，但毕竟不是专业的，可能走线和布局还不够好。
非常感谢您！
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