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分享 [ZZ]知识点理解:无杂散动态范围(SFDR)
wildgoat 2019-9-21 23:42
http://www.sohu.com/a/342377901_695278?spm=smpc.author.fd-d.1.1569080384700G9WJDUj 无杂散动态范围(Spurious Free Dynamic range ,SFDR) 是衡量A/D和D/A数据转换器(ADC/DAC)的指标,表示在杂散分量干扰基本信号或导致基本信号失真之前可用的动态范围。 SFDR定义: 正弦波信号(载波)均方根 ...
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分享 使用 eMMC 闪存设备的磨损估计
toradex 2019-9-18 11:30
​ 几十年来,闪存一直是嵌入式系统的一个重要课题。与其他存储技术相比,它允许大幅改进电子设备的大小和鲁棒性。闪存存储的其他优势包括缺少移动部件和降低功耗。然而,闪存的挑战并没有在消费类电子产品中广为宣传。其中包括有限的耐用性和更高的软件复杂性。 图 1 :从 U 盘驱动器和 SD 卡 ...
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分享 基于FPGA的OFDM通信系统
hlayumi 2019-9-17 18:56
设 OFDM 信号发射时间周期为 ,子载波数为 N , N 也是符号序列的时间间隔。可以证明满足子载波正交的条件为: =1/T 。(式中 为子载波的频率间隔。)输入数据流首先被 QAM 调制器调制,这里其实是完成一个星座点的映射过程,并没有进行频谱搬移。经过星座映射后得到的符号,存在两个相互正交的分量 ...
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分享 基于FPGA的智能PID控制器的设计
mat7labs 2019-9-17 18:55
这里整个基于 FPGA 的智能 PID 控制器的总体结构包括 PID 模块, RBF 参数整定模块,以及控制对象 模块 ,这里,控制对象模块我们采用一个小型电机做为控制对象进行控制器的测试, RBF 参数整定值,直接通过外部 MATLAB 仿真获得。因此这里我们主要设计的是 PID 控制器和控制器两个部分。 ...
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分享 SPECTRE:利用dc_pivot_check=yes改善DC analyses收敛
moszheng 2019-9-17 14:33
https://community.cadence.com/cadence_technology_forums/f/custom-ic-design/35509/how-to-use-the-gmin_check-option-set-option-dc_pivot_check-yes https://community.cadence.com/cadence_technology_forums/f/custom-ic-design/24913/information-on-dc_pivot_check-option 以上两贴基本讲清dc_pivot_chec ...
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分享 (python3) path analysis from report -part
rioshiina 2019-9-16 17:43
import re file_r = "/xxx/Documents/rpt1.tcl" w1 = "Startpoint: " w2 = "_DEL_" w3 = "slack 2" i = 0 j = } with open(file_r) as f_r: for line in f_r.readlines(): if re.search(w1, line): i=i+1 ...
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分享 2.6 RTL设计关键要点-时序与电路
rosshardware 2019-9-16 14:36
2.6	RTL设计关键要点-时序与电路
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