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分享 5.1时的照片: zhaijt_123 2006-8-23 11:58; 暂无; 544 次阅读|0 个评论

分享 5.1时的照片: zhaijt_123 2006-8-23 11:51; 暂无; 546 次阅读|0 个评论

分享挑战30天C/C++ 入门极限系列教程: zhaijt_123 2006-8-23 11:48; 天气 : 晴朗心情 : 高兴 http://tech.163.com/special/g/00091ASL/guanningC.html; 622 次阅读|0 个评论

分享 CPLD开发板和FPGA开发板的区别: zhaijt_123 2006-8-23 10:20; 天气 : 晴朗心情 : 高兴 ① ＣＰＬＤ更适合完成各种组合逻辑,ＦＰＧＡ更适合于完成时序逻辑。换句话说,ＦＰＧＡ更适合于触发器丰富的结构,而ＣＰＬＤ更适合于触发器有限而乘积项丰富的结构。 ② ＣＰＬＤ的连续式布线结构决定了它的时序延迟是均匀的和可预测的,而ＦＰＧＡ的分段式布线结构决定了其延 ...; 649 次阅读|0 个评论

分享一些有用的国外站点及资源！: zhaijt_123 2006-8-23 10:13; 天气 : 晴朗心情 : 高兴 thefollowing links point to some servers containing "non commercial" VHDL models. Note, www.eetop.cn:q8ff5? ...; 1305 次阅读|0 个评论

分享 TTL和CMOS电平: zhaijt_123 2006-8-23 10:02; 天气 : 阴雨心情 : 郁闷 TTL和CMOS电平 1，TTL电平：输出高电平2.4V,输出低电平0.4V。在室温下，一般输出高电平是3.5V，输出低电平是0.2V。最小输入高电平和低电平：输入高电平=2.0V，输入低电平=0.8V，噪声容限是0.4V。 2，CMOS电平： 1逻辑电平 ...; 807 次阅读|1 个评论热度 1

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