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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

日志

脚本| 设计| 验证|

分享设计前准备: e_er 2014-3-24 20:21; 设计不能一上来就写代码，总体架构很重要，详细设计也很重要。首先时钟方案，复位方案，初始化方案（加载、初始化配置等），时钟域划分（尽量做到同时钟域），都要开始时想清楚，这样才能避免后期大改，或是每有修改都到处掣肘。详细设计则要将模块间接口，模块内部处理层次划分，时钟域转换方式，接 ...; 个人分类: 设计|734 次阅读|0 个评论

分享高速口接口设计: e_er 2014-3-19 20:19; serdes高速接口，可以实现芯片间、单板间高速传输，节省走线资源、高效低误码、接口时序不需要分析的传输，是目前常用的接口设计。关键的技术有，CDR随数据恢复时钟，B10编解码等。xinlinx器件中serdes硬core主要包含以下几部分：PMA层、PCS层。其中PMA主要是完成，数字模拟域转换、模拟电路（接收均 ...; 个人分类: 设计|2428 次阅读|0 个评论热度 1

分享 xilinx器件寄存器初始值设计: e_er 2014-3-18 21:47; xilinx器件，开发代码中的变量初始值怎么确定的？首先初始值，有两种，一是configuration初始值；一是reset初始值。前者是fpga加载后的初始值；后者是复位后的初始值。初始值如何定义。如果没有显性的定义，加载后的初始值，会根据代码中编写代码的复位初值用作configuration初值。如果需要显性的 ...; 个人分类: 设计|2985 次阅读|0 个评论

分享维测设计: e_er 2014-3-5 21:42; 基本的设计功能不难，难在可靠性以及可维可测性。维测有很多方式，锁存指示、实时指示、计数统计、事件触发锁存、按顺序锁存信息等。根据要解决的问题，以及信号的特点，确定使用的维测手段。如果问题现象尚在，或者可较高概率复现，则实时的信息读取，异常统计信息的读取是很好的手段； ...; 个人分类: 设计|2042 次阅读|0 个评论

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