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分享关于时钟的讨论！！: yuedx 2009-4-2 10:12; 无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将导致错误的行为，并且调试困难、花销很大。在设计PLD/FPGA时通常采用几种时钟类型。时钟可分为如下四种类型：全局时钟、门控时钟、多级逻辑时钟 ...; 个人分类: FPGA设计基础知识|1303 次阅读|1 个评论热度 1

分享关于毛刺问题的探讨！！: yuedx 2009-4-2 10:05; 和可靠性有关的几个概念　　 1. 几个基本概念：建立时间和保持时间　图 1 建立时间（setup time）是指在触发器的时钟信号上升沿到来以前，数据稳定不变的时间，如果建立时间不够，数据将不能在这个时钟上升沿被打入触发器；保持时间（hold time）是指在触发器 ...; 个人分类: FPGA设计基础知识|2989 次阅读|0 个评论

分享 PLD/FPGA 结构与原理初步（二）: yuedx 2009-4-2 10:04; 一.查找表（Look-Up-Table)的原理与结构采用这种结构的PLD芯片我们也可以称之为FPGA：如altera的ACEX,APEX系列,xilinx的Spartan,Virtex系列等。查找表（Look-Up-Table)简称为LUT，LUT本质上就是一个RAM。目前FPGA中多使用4输入的LUT，所以每一个LUT可以看成一个有4位地址线的16x1的RAM。当用户通 ...; 个人分类: FPGA设计基础知识|1454 次阅读|0 个评论

分享 PLD/FPGA 结构与原理初步（一）: yuedx 2009-4-2 10:03; 一.基于乘积项（Product-Term)的PLD结构采用这种结构的PLD芯片有：Altera的MAX7000，MAX3000系列（EEPROM工艺）,Xilinx的XC9500系列（Flash工艺）和Lattice,Cypress的大部分产品（EEPROM工艺）我们先看一下这种PLD的总体结构（以MAX7000为例，其他型号的结构与此都非常相似）：图1 基 ...; 个人分类: FPGA设计基础知识|1339 次阅读|3 个评论

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