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分享 AHB APB 最简通信: 2019-2-28 18:30; 天气 : 晴朗心情 : 平静 AHBAPB 工程说明目录 TOC \o 1-3 \h \z \u AHBAPB 工程说明 ... PAGEREF _Toc536313758 \h 1 08D0C9EA79F9BACE118C8200AA004BA90B02000000080000000E0000005F0054006F00630035003300360033003 ...; 1491 次阅读|1 个评论热度 1

分享用PLA实现下述比较逻辑: 2019-1-31 00:03; 输入： A , B 输出： LET ， GET 如果 A = B LET=0, GET=1 如果 A = B LET=1, GET=0 真值表如下：卡诺图如下： LET = B A ’A ’ + B A ’ + B B A ’ GET = B ’B ’ + B ’ A + B ’ A + A A + B ...; 743 次阅读|0 个评论

分享用PLA实现比较逻辑: 2019-1-30 23:46; 543 次阅读|0 个评论

分享设计一个合理结构的32-1MUX: 2019-1-30 23:35; module MUX32_1(sel32, i32, o32) begin input sel32; input i32; output o32; wire a; wire b; MUX4_1 U0 ( .sel4(sel32 ), .i4(i32 ), .o4(a ) ); ...; 793 次阅读|0 个评论

分享用verilog实现16bit数据的算术右移功能: 2019-1-30 23:34; module ShiftR_N(num, i1, o1) begin input num; input i1; output o1; wire tempo assign tempo = { 16{i1 }, i1 } num; assign o1 = tempo ; endmodule; 1703 次阅读|0 个评论

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