日志
- 分享 book_kit
- 一. language 1 systemverilog LRM IEEE std 1800 2 systemverilog for verification A guide to learning the testbench language features (2nd/3rd edition) 3 cadence/synopsys sv ppt+lab 4 verilog LRM IEEE std 1364 5 sy ...
- 分享 约束所在
- 1 背景 UVM的方法学激励需要施加有效约束，本文总结各种约束。 2原则 原则1：在pkt（item）中的约束要考虑周全，要适当，不能过紧，排除不可能的情况，并明确variable的关系即可。 原则2：其他约束放在sequnce中，每个sequence对应了一个case(pattern) 3. 具体原则2的约束总 ...
- 分享 ASIC项目管理（转载）
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- L1: ast case cbk cov dut flist fay refm sim tb uvm readme(file) L2/3/more: refm - xxx - src refm - xxx - doc refm - xxx - test sim -makefile(linkfile) &nbs ...
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- VIP_DIR= VIP_SRC = PMOD_DIR= PMOD_SRC = REFM_DIR= REFM_SRC = comvip: @ cd misc; mkdir -p $(TESTNAME); cd $(TESTNAME); mkdir -p $SEED) @ irun -compile $(BASIC_OPTS) $(VIP_SRC) compm: &nb ...
- 分享 makefile(2)
- BASIC_OPTS += -64 BASIC_OPTS += -access + r # +rwc BASIC_OPTS += -timescale 1ns/1ps BASIC_OPTS +=-status BASIC_OPTS +=-sv BASIC_OPTS +=-licqueue BASIC_OPTS +=-allowredefinition BASIC_OPTS +=-nclibdirpath $(TB_SRC_DIR)/sim/misc/$(TESTNAME)/$(SEED) BASIC_OPTS +=-nclibd ...
- 分享 makefile(1)
- .PHONY: defalut help clean default:help VERBO = UVM_DEBUG SEED_TIME = SEED_CPU= .... SEED:=$(shell expr $... TESTNAME=test$* TESTID=$(TESTNAME)_$(SEED) WAVE=no PKTNUM=3 AST= COV= LOG_DIR = ./log COV_LOGDIR=./log/cov DUT_SRT += -f ../dut/rtl.flist PJ ...
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