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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

日志

FPGA学习汇总贴| 芯片采购| 学习板| 书籍文章分享|

分享 FPGA其他问题: chop147 2022-6-18 19:00; 【问题1】如何知道ddr3里不空，可以读取了？答:DR3和RAM一样，是一个存储器件，它的每个内部单元都存储了当前的数据状态值。但DDR3和RAM本身，是没有“空”、“存有数据”，“数据满”等概念的。只要给地址，它就会把当前地址的数据给到总线上，而且这个地址可以读很多次。在设计的时 ...; 个人分类: FPGA学习汇总贴|907 次阅读|0 个评论

分享 MDY专题课产品交流(JESD204B)【汇总贴】: chop147 2022-6-17 06:39; 【问题11.31】如果我这里有两个9144芯片，他们之间如何同步呢？答：1. 时钟同步，采用同一个时钟芯片，由这个时钟芯片产生多路时钟给这些AD9144，由于时钟源是相同的，所以时钟都是一样的。这样可以保证时钟的同步。 2. 由于都是一个FPGA发数据，按照JESD204B排列数据分配给各条 ...; 个人分类: FPGA学习汇总贴|654 次阅读|0 个评论

分享精密仪器项目(JESD204B): chop147 2022-6-16 06:24; 【问题11.16】为什么v5版本是6.4Glane速率，而v7就是3.2Glane速率了，都是10~40M的正弦波啊？答：LANE的速率，可以大于等于“需要的速率”，只要能保证传输即可。【问题11.17】专题课实现的最高采样率是多少？答：专题课里有多个工程案例，实现的最高采样率是1Gbps。理论上，AD9144是可以实现2 ...; 个人分类: FPGA学习汇总贴|491 次阅读|0 个评论

分享【教程】史上最干货的Verilog语法课程_6小时掌握Verilog语法: chop147 2022-6-14 08:31; 1、在**找着零散的资料？ **资源多而零散，缺乏系统性，严重影响学习热情；并且**资源质量参差不齐，很有可能学到一些错误的知识。 2、拿着厚厚一本 Verilog 语法书看，看会儿就困？语法这部分本来知识点就多，学起来相对枯燥，如果只看书自然会感觉枯燥无聊；走马 ...; 个人分类: FPGA学习汇总贴|499 次阅读|0 个评论

分享 MDY专题课产品交流【汇总贴】: chop147 2022-6-13 06:47; 九、PCIE专题课【问题9.1】 PCIE视频教程是否有讲简单的pio数据交互？答：有此方面的内容。【问题9.2】多少通道都可以吗？答：是的，都可以。【问题9.3】为什么我得pcie板卡驱动识别为PCI standard RAM Controller而不是pci设备或者未知设备呢？答：可能Windows自带 ...; 个人分类: FPGA学习汇总贴|309 次阅读|0 个评论

分享 MDY专题课产品交流【汇总贴】--时序约束专题课: chop147 2022-6-10 05:54; 八、时序约束专题课 (全部内容时序约束的问题，请看如下帖子： http://www.mdy-edu.com/wentijieda/20210410/1294.html ) 【问题8.1】 VIVADO的时钟约束向导，常无法找到时钟，如下图所示，位置1中应该要识别出时钟。答：请注意，位置1的地方是列出的是“没有被约束的时钟”，如果该时钟已经被约束了 ...; 个人分类: FPGA学习汇总贴|1441 次阅读|0 个评论

分享 MDY专题课产品交流【汇总贴】: chop147 2022-6-8 07:11; 二、高手修炼专题课【问题2.1】计数器练习的9.4节中，第二个计数器的代码为什么是计30个呀？我认为应该是3*（8+1）+2=29个。答：数据位一共是27位，开始位1位，结束位1位，还要注意看上图中，第三字节x后还有1位的0，之后才是结束位，所以一共是30位。三、实用调试技巧专题课 ...; 个人分类: FPGA学习汇总贴|311 次阅读|0 个评论

分享 MDY专题课产品交流【汇总贴】: chop147 2022-6-6 08:14; 如果同学们的问题我们帖子里面没有的请第一时间联系我:微信同步：13112063618易老师，我们对新问题进行补充！持续更新！一、SDRAM和DDR专题课【问题1.1 】 DDR3那个课程，一般线速率能跑到多少？答：本课程的DDR3内容，是基于XILINX K7芯片，使用的是VIVADO平台。DDR3的时钟频率是800M。用户侧时钟 ...; 个人分类: FPGA学习汇总贴|247 次阅读|0 个评论

分享 MDY案例交流【汇总贴】: chop147 2022-5-27 08:05; 如果同学们的问题我们帖子里面没有的请第一时间联系我:微信同步：13112063618易老师，我们对新问题进行补充！ 1. AD和DA案例 1.1 案例编号：000400000001 简易示波器【问题1.1.1】下载开发板后，无波形显示答：可能的原因有如下，请逐个确认排除： 1. SMA线注意是要公头，请与开发板核对一下。 2. 信号发生器没有 ...; 个人分类: FPGA学习汇总贴|253 次阅读|0 个评论

分享测试文件答疑【汇总贴】: chop147 2022-5-26 07:01; 【问题1】这是出了什么问题？din输入的值出问题了？答：这种情况的错误提示，如果是三态门（inout）管脚例化时，请按如下方法进行： 1.如果是初级入门，可以看测试文件编写、和测试文件模板视频； 2、如果要提高，可以看测试文件训练等资料，里面包括随机数等产生方法； 3、如果更高级的，可以看高 ...; 个人分类: FPGA学习汇总贴|303 次阅读|0 个评论

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