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日志

非技术| 锁相环| 仿真问题|

分享关于VCO的多频点的线性度: 胭脂盗 2016-9-27 16:44; 在前一篇文章中，提出了如果要实现线性的频率点，那么就需要非线性的电容阵列值。因此采用分段法来逼近非线性电容曲线。最后vco的pss仿真得到的频率范围大大缩水！; 个人分类: 锁相环|1501 次阅读|0 个评论

分享 VCO学习第一周: 胭脂盗 2016-9-5 09:06; 距离上一次发布日志已有一个月了，中间暑假休息了有20+天，上一周完成了vco的基本原理的学习和进行了一次实验，掌握了部分vco仿真方法。以下是上周的笔记。基本原理： 1 、具有负反馈性质的放大器，而放大倍数 ------ 放大器增益≥ 1. 2 、反馈回来的信号相位相反 ----- 负反馈。 ...; 个人分类: 锁相环|3729 次阅读|0 个评论

分享目前还在积累的问题: 胭脂盗 2016-7-31 20:54; 经过这一段时间的pll学习与设计，喔！仅仅是建模。现在积累了一些问题有待解决 1、在ken kundert的《Predicting the Phase Noise and Jitter of PLL-Based Frequency Synthesizers》还是不能正确地定义phase类型的端口，以及用white_noise和flicker_noise函数来模拟白噪声和闪烁噪声。 2、在整数分频时，环路虽然稳定了 ...; 个人分类: 锁相环|1118 次阅读|0 个评论

分享貌似pll开始一个月了，总结一下咯: 胭脂盗 2016-7-31 20:26; 心好累！！！说是不知不觉一个月就过去了，可是在黑板上写了倒计时，开始写的40天（回家倒计时）到今天还有11天，每天把数字擦去写上，还是能感觉到时间过得好快。而与时间并不对等的就是我的成果。差不多一个月吧，也该总结一下了。大概花了一周多时间在cppsim上，然并软！最后还是选择Verilog-a建模，大概花了一周时间 ...; 个人分类: 锁相环|1174 次阅读|0 个评论

分享导航接收机频综指标以及环路参数定义: 胭脂盗 2016-7-19 09:36; 通过对《GSM频综设计流程》的学习，以及参考其他论文，针对导航接收机频综进行指标的设计，以及环路参数的计算。 VCO 参数与指标：相位噪声： - 120dBc/Hz@1MHz 电流：小于 4mA 覆盖频点： BD2 B1 频点（ fo=1561.098 BW=2.046 ） GPS L1 频点（ fo=1575.42 BW=1.023 ） ...; 个人分类: 锁相环|1486 次阅读|0 个评论

分享 GSM频综设计流程教程学习笔记: 胭脂盗 2016-7-11 20:40; Fractional-N Frequency Synthesizer Design Using The PLL Design Assistant and CppSim Programs 思路整理 1 ，要实现稳定时间小于 150ms 在小于 10ppm 频率误差下。 2 、 - 80dBc 的杂散性能规格： 1 、带宽： ...; 个人分类: 锁相环|2718 次阅读|0 个评论

分享学习笔记《PLL Design Using the PLL Design Assistant Program》: 胭脂盗 2016-7-11 20:39; XOR FPD ： 1 、在相位误差特性上具有高线性度。 2 、完全避免了死区问题 3 、更高的 PFD 噪声和参考杂散 Tristate PFD ： 1 、 UP 和 DOWN 的失配降低了线性度 2 、在 reset 路径增加延迟单元来避免死区问题在Σ △ Fractiona ...; 个人分类: 锁相环|3357 次阅读|0 个评论

分享 PLL第二周: 胭脂盗 2016-7-11 20:05; 从6月26号，发帖声明开始做pll，现在正好有两个礼拜。原贴地址《锁相环从入门到进阶到放弃》 http://bbs.eetop.cn/viewthread.php?tid=606264extra=page=1 这两周时间除了考试和其他耽误了一些时间，差不多花了挺多时间pll这件事上的。主要完成了学习cppsim的教程，其中包括了用pll design assista ...; 个人分类: 锁相环|2642 次阅读|1 个评论热度 2

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