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tessent 集成VCS仿真验证的方法

热度 22已有 1927 次阅读| 2022-10-31 19:08 |系统分类:芯片设计| dft

  1. 指定stdcell,io,memory等模块的仿真模型

    -->set_simulation_library_source -f ./all_model.f

  2. 设置VCS安装目录

    -->setenv VCS_HOME /tools/syn/vcs_mx-2022.6-SP1/

  3. 运行仿真命令指定仿真器是vcs

    -->run_testbench_simulations -simulator vcs


另外需要说明的是如果是前仿真，因为没有sdf的缘故出现时序违例的问题导致仿真不通过，可以进入tessent自动生成的仿真目录修改vcs.simulation_scrip，在vcs命令添加nospecify，或no_notifier和notimgcheck。

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发表评论 评论 (3 个评论)

回复 guiqix 2023-2-23 16:32
run_testbench_simulations 命令支持vcs compile/simulation command，nospecify、notimingcheck都可以直接设定，不用手动修改simulation环境文件
回复 费米能级 2023-7-17 23:34
guiqix: run_testbench_simulations 命令支持vcs compile/simulation command，nospecify、notimingcheck都可以直接设定，不用手动修改simulation环境文件 ...
编译选项如 -v2005也可以吗
回复 guiqix 2023-7-19 14:12
费米能级: 编译选项如 -v2005也可以吗
没试过，只要是VCS option都可以

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