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定位Error: (vsim-3601)

已有 2731 次阅读| 2012-10-25 09:27 |个人分类:设计经验

在modelsim下仿真出现：Error: (vsim-3601) Iteration limit reached at time

1. 传统办法，在仿真中切支路赋值仿真逼近法

2. DC综合法，将代码放在DC中综合，出现信息“Information：Timing loop detected.(OPT-150)”的地方即是造成仿真错误vsim-3601的点~

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