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已有 354 次阅读| 2024-5-21 11:57 |个人分类:学习笔记|系统分类:芯片设计


##NW space must be >=1um

check_NW_space{@ IO NW space to NW >=1um

          EXT LVNW HVNW < 1 ABUT < 90 SINGULAR REGION 

          EXT HVNW < 1 ABUT < 90 SINGULAR REGION          

          }

##PA width must == 3um

check_PA_width{@ PA between ALPA and TM2 size must be 3um x 3um except PA in PAD 

               X = NOT RECTANGLE RDV == 3 BY == 3

               X NOT DUPMK1

  }

//check metals  not connect to AA gate res mom  

float_M1{

              metal_no = NET AREA RATIO metal1 diff gate metal1_shield metal2_shield metal3_shield metal4_shield metal5_shield metal6_shield rpoly_T == 0 [!!AREA(diff)+!!AREA(gate)+!!AREA(metal1_shield)+!!AREA(metal2_shield)+!!AREA(metal3_shield)+!!AREA(metal4_shield)+!!AREA(metal5_shield)+!!AREA(metal6_shield)+!!AREA(rpoly_T)]

     copy  metal_no

        }

//check via between top and bottom metal// jin jian cha xiang lin metal de kong //

check_ct{

        poly_co = poly NOT AA

        ct_co = (metal1 AND diff CONNECTED) OR (metal1 AND poly_co  CONNECTED)

        ct_co1 = ct_co INTERACT CT 

        ct_co1a = ct_co NOT ct_co1

        ct_co2 = ct_co1 NOT (CT SIZE BY 0.07)

        ct_co3= (ct_co2 SIZE BY -0.02) SIZE BY 0.02

        error = ct_co3 OR ct_co1a

        copy error

        }



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