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EMAC接口--MII协议学习笔记

已有 11285 次阅读| 2016-10-18 16:32 |个人分类:EMAC接口|系统分类:芯片设计

  

简介

MII是英文Medium Independent Interface的缩写,翻译成中文是“介质独立接口”,该接口一般应用于以太网硬件平台的MAC层和PHY层之间,MII接口的类型有很多,常用的有MIIRMII、SMII、SSMII、SSSMII、GMIIRGMII、SGMII、

TBI、RTBI、XGMII、XAUI、XLAUI等。

MII支持10Mb/s100Mb/s4bitdata宽度,支持自协商,

 

 

TX_CLK连续的发送端参考时钟,为TXDTX_ENTX_ER提供参考时钟,100Mbps速率下,时钟频率为25MHz10Mbps速率下,时钟频率为2.5MHz。注意,TX_CLK时钟的方向是从PHY侧指向MAC侧的,因此此时钟是由PHY提供的。

RX_CLK连续的接收数据参考时钟,RXD/RX_DV/RX_ER提供参考时钟,100Mbps速率下,时钟频率为25MHz10Mbps速率下,时钟频率为2.5MHzRX_CLK也是由PHY侧提供的。

TXD(Transmit Data)[3:0]:数据发送信号,共4根信号线;

TX_EN(Transmit Enable): 发送使能信号,只有在TX_EN有效期内传的数据才有效;

TX_ER(Transmit Error):  发送数据错误提示信号,同步于TX_CLK,高电平有效,表示TX_ER有效期内传输的数据无效。对于10Mbps速率下,TX_ER不起作用

计算机生成了可选文字:
|0TX_CLK 
TX EN 
TXD<3:O> 
CRS 
COL 
.000@到:00:0到:0的:到:0的00- 
Figure 22 4 
Transmission With no collision

 

RXD(Receive Data)[3:0]:数据接收信号,共4根信号线;

RX_DV(Reveive Data Valid): 接收数据有效信号,作用类型于发送通道的TX_EN从接收到的第一个半bit一直到接受到的最后一个半bit

RX_ER(Receive Error)  接收数据错误提示信号,同步于RX_CLK,高电平有效。当PHY接收到code error或者其他PHY可以检测到的error时,将此信号拉高,表示RX_ER有效期内传输的数据无效。对于10Mbps速率下,RX_ER不起作用


计算机生成了可选文字:
|0RX_CLK 
RX DV 
RXD<3:O> 
RX ER 
Figure 22—7—Reception with errors


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