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Verilog中阻塞赋值与非阻塞赋值的区别 2020-12-25
IEEE Verilog标准中提供了阻塞赋值和非阻塞赋值两种赋值方式，二者的执行过程如下： 1.阻塞赋值(=)：阻塞赋值操作实质上是一次性连续完成的，即计算等号右边变 ...
(1729)次阅读|(0)个评论
QuestaSim仿真时transcript窗口没有display信息 2020-12-17
原因：电脑用户目录有中文名。 在装很多软件，例如myEclipse10等，都不支持中文路径名，所以出现了好多bug。在此，支持大家无论新建什么关于系统的东西， ...
(4109)次阅读|(0)个评论

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