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- 分享 2024-12-17
- JTAG, JTAG Initial, Reset and change to Run Test/Idle, 5 + 1 TCK. send_package: ____ ___| |
- 分享 DFT
- set dft signal -view existing dft -type ScanClock -hookup pin -timing Discarded dft sianal specification set_dft_drc_configuration -internal_pins on 如果hookup_pin是internal pin(无法直接通过port trace到的，如时序逻辑的输出pin)，就需要打开internal_ ...
- 分享 2024-11-18
- 前言 我们在实际设计中可能会碰到这种情况，如果我们的memory最高只能工作到800Mhz频率，但是我们却让它工作在1Ghz的频率，这时就会出现min period的violation。 一、什么是 min period？ Min period也就是最小时钟周期，是DRV检查的一种。Min period用于检查时钟电路是否达到了预期的工作频率。例如min pe ...
- 分享 IO pad
- 1 增加例化到网表： 2 增加IO file Innovus加电源pad的流程是怎么的？ - 后端讨论区 - EETOP 创芯网论坛 (原名：电子顶级开发网) - addIoInst -inst vcckRIGHT -cell VCCKLA -ori R90 -loc {3554.32 169.4} addIoInst -inst gndkRIGHT -cell GNDKLA -ori R90 -loc {3554.32 225.4} ad ...
- 分享 Xilinx-7系列FPGA
- Xilinx-7系列FPGA 主要包括：Spartan®-7、Artix®-7、Kintex®-7、Virtex®-7。其性能、密度、价格也随着系列的不同而提升。和前几代FPGA产品不同的是，7系列FPGA采用的是统一的28nm设计架构，客户在不同子系列的使用方式上是统一的，消除了不同子系列切换使用带来的不便。 Xilinx的四个工艺级别 ...
- 分享 【Innovus】总结了十条消除DRC和Antenna的方法
- 密密麻麻的线，像高架桥一样，不能交叉，还要保证留够宽度和间距。有时候APR工具并不是那么智能，需要人工干预才能达到满意的效果。下面总结了工作中遇到的Route后DRC、Antenna等问题的几个解决方法。 第一步，不修antenna，降低Timing的优化强度，关掉SI，进行detail route。 setNanoRouteMode -drouteFixAnte ...
- 分享 Cortex-M55的单片机AI技术Helium
- https://zhuanlan.zhihu.com/p/225231360 说明： 1、2019年年初的时候ARM发布Armv8.1-M架构，增加了Arm Helium技术。 2、今年4月份发布的CMSIS5.7.0支持Cortex-M55，发布DSP库加强版（有大量的Helium API添加了进来）和机器学习库 。 电子书下载： arm-helium-technology-ebook.pdf (4.31MB) 知识 ...
- 分享 文档写作系统
- 1 安装 sphinx 官方安装说明： http://www.sphinx-doc.org/en/master/usage/installation.html readthedoc 官方说明： https://docs.readthedocs.io/en/stable/intro/getting-started-with-sphinx.html 总的来说步骤如下： • 安装 python3 • 通过 python3 安装 sphinx 包 python3 ...
- 分享 spyglass 使用
- 1 sdc2sgdc : current_designu_top set_optionsdc2sgdcyes sdc_data-filexxx.sdc 生成xxx.sgdc.out 文件 2 check file: xxx/cdc/cdc_verify/spyglass.log xxx/cdc/cdc_verify/xxx.sgdc.out consolidated_reports/xxx/
- 分享 CRYPTO1: 密码分析学
- https://zhuanlan.zhihu.com/p/465900396
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