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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

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最新发表的日志| 推荐阅读的日志 | 芯片设计 | 硬件设计 | 嵌入式 | 人工智能 | 生活杂谈 | 其他

分享 MDY专题课产品交流(JESD204B)【汇总贴】: chop147 2022-6-17 06:39; 【问题11.31】如果我这里有两个9144芯片，他们之间如何同步呢？答：1. 时钟同步，采用同一个时钟芯片，由这个时钟芯片产生多路时钟给这些AD9144，由于时钟源是相同的，所以时钟都是一样的。这样可以保证时钟的同步。 2. 由于都是一个FPGA发数据，按照JESD204B排列数据分配给各条 ...; 662 次阅读|0 个评论

分享技术培训 | 6月29日，“Design Compiler NXT: RTL Synthesis培训”开课！ ...: 青岛EDA中心 2022-6-16 16:53; 物理综合技术是数字电路设计工程师必须要掌握的一项技能，是RTL到物理实现的起点，而物理综合是一个很复杂的过程，环境、工艺库设定、时序约束编写、综合时序问题分析等等均需要综合时具有专门的知识和技能，一个好的综合网表同时也可以提高后端物理实现的质量和效率。 6月29日~7月1日，中科芯云微电子科技有限公司（ ...; 740 次阅读|0 个评论

分享 FPGA取代CPU、GPU成为机器人新宠: chop147 2022-6-16 14:44; 十年前，微软创始人比尔·盖茨在其文章《A Robot in Every Home》里提出他对未来的憧憬：机器人将会像个人电脑一样进入每个家庭，为人类服务。随着人工智能以及智能硬件在过去几年的飞速发展，到了2016年的今天，笔者坚信各项技术已臻成熟，智能机器人很快进入商业化时代，盖茨的愿景也极有可能在5到10年内实现。要想机 ...; 452 次阅读|0 个评论

分享 VHDL调用verilog模块，接口类型不一致报错，如何解决？: karyen 2022-6-16 11:05; VHDL文件A，调用Verilog文件B A文件中： b：in integer range 0 to 11; signal l : integerrange 0 to 11; signal m : integerrange 0 to 11; u_B: B port_map( ...; 703 次阅读|0 个评论热度 1

分享精密仪器项目(JESD204B): chop147 2022-6-16 06:24; 【问题11.16】为什么v5版本是6.4Glane速率，而v7就是3.2Glane速率了，都是10~40M的正弦波啊？答：LANE的速率，可以大于等于“需要的速率”，只要能保证传输即可。【问题11.17】专题课实现的最高采样率是多少？答：专题课里有多个工程案例，实现的最高采样率是1Gbps。理论上，AD9144是可以实现2 ...; 494 次阅读|0 个评论

分享 NFMJMPC226R0G3D电容器符合AEC-Q200标准、BMA456应用: mjd888 2022-6-15 14:23; NFMJMPC226R0G3D NFM 3端子滤波电容器设计用于超大电流低等效串联电感 (ESL) 芯片。该ESL值低且极为可靠，并具有高频特性。这些电容器适合用于为高速工作的电源去耦，可在高达几百MHz的高频范围内提供良好的噪声抑制效果。NFM滤波电容器是采用小型封装的三端子多层陶瓷电容器。这些电容器符合AEC-Q200标准，适用于高质量 ...; 417 次阅读|0 个评论

分享 RISC-V科普：开放式的ISA: jackzhang 2022-6-14 12:20; 来源：EETOP编译自allaboutcircuits https://www.allaboutcircuits.com/technical-articles/introductions-to-risc-v-instruction-set-understanding-this-open-instruction-set-architecture/ 本文是RISC-V基础知识的入门篇。介绍了开放式架构理念，以及模块化ISA的技术描述，以及一些商业RISC-V微处理器实现。 ...; 1858 次阅读|0 个评论热度 12

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