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日志

分享 cadence 6.1 corner and monte carlo 操作设置
2018-4-27 10:52
自己总结下软件操作,老记不住。 首先corner 和monte carlo不能同时仿真。 1. corner: 在ADE里launch里先选择ADE XL,新建窗口;在create corner里放入各种ff,ss的组合(9个),方针即可 2. 蒙特卡洛: corner的不用再选了 先在ADE的output里setup新的信号,自己取名字,expression要通 ...
个人分类: 模拟IC设计|6535 次阅读|0 个评论 热度 1
分享 esd 好文
2016-10-18 17:22
一直想给大家讲讲ESD的理论,很经典。 但是由于理论性太强,如果前面那些器件理论以及snap-back理论不懂的话,这个大家也不要浪费时间看了。 任何理论全都是一环套一环的,如果你不会画鸡蛋,注定了你就不会画大卫 静电放电(ESD: Electrostatic Discharge),应该是造成所有电子元器件或集成电路系统造成过度电应力(EOS: ...
个人分类: 模拟IC设计|9962 次阅读|5 个评论 热度 7
分享 dc-dc layout总结经验及心得 后续
2016-2-22 09:57
继续补充下layout过程中的问题和心得,,,, 1.在顶层放置各个cell时时是讲究的,在这一点上由于自己擅作主张,比如pwmcomp和采样模块离的很远造成vsum信号易受干扰。还有bg及bias一般也要在中间;吵闹的信号或者cell要离模拟(“安静”)信号或cell远些;driver可以放在大管旁边(一般可以在芯片的边缘)。总而言之, ...
个人分类: 模拟IC设计|3109 次阅读|0 个评论
分享 dc-dc layout总结经验及心得
2016-2-19 16:49
自己做的dc-dc(PY15)再同事那里layout,谈谈注意事项和心得。 先谈谈具体的细节: 1.pwmcomp的cell与cs-amp(采样)要离的近些,从cs-amp里面采样得到的上管电流进入pwmcomp里面产生vsum电压(与comp比较),所以vsum距离很长,导致容易让vsum受到干扰;所以最好要离的近。 其余后面再总结,哈哈!下班了 ...
个人分类: 模拟IC设计|3178 次阅读|0 个评论
分享 日志 [2016年01月08日]
2016-1-8 14:35
即便你只是一个工程师,在当今社会,若忽视了与人团结协作的能力那也是不行的,与同事维持良好的关系也会让你的工作和事业事半功倍。总结下自己的一个毛病: 1.日前,与同事聊到过年回家给外甥红包时,我非得问他要给多钱啊!有点过分打听的意思,其实,别人想告诉你的会说给你的,不必过于去问。 只有不断把总结的问题 ...
个人分类: 做人做事|1106 次阅读|0 个评论
分享 做项目时的小总结
2015-12-30 17:50
1.负载接电阻和恒流源(直接拉载)是一样的,不会影响稳定性的结果,你该不稳还是不稳,在仿真时不要在此浪费时间,一会又恒流源,一会又上电阻。 2.对于电流模的跨导型补偿,在comp端接R,C串联补偿的,为省面积,电容用pmos的如果能稳定,那么用nmos的电容,一般也会稳定(虽然,在压差小时电容值偏小些),而且没有latch ...
个人分类: 模拟IC设计|1335 次阅读|0 个评论
分享 模拟学习感悟与总结
2015-5-22 23:26
最近一直有些受打击,做模拟也有一年多了,基础也不是很好,主要是解决问题的思路不对,发现成长的挺慢的,最近也被师傅批得都没信心了,你知道技术工程师如果技术不过硬很难混下去的。好吧!毕竟自己还是对模拟有兴趣的,除了认真反思总结外,还得振作重拾信心啊!哪怕成长的过程再痛苦,有时 ...
个人分类: 日志|2029 次阅读|0 个评论 热度 4
分享 Hspice仿真的收敛性问题
2015-3-11 11:12
Hspice仿真电路不收敛,说白了就是就是计算机解矩阵解不出来了。 不收敛的原因可能有三个方面造成: (1).hspice的计算上面.以上换算法,换options都是根据这一点来的。一般说来,这样的情况占绝大多数 (2).Model的问题。比如产生负的电导,或者模型不连续性造成。 (3).电路本身问题 比如网表不 ...
个人分类: 模拟IC设计|5947 次阅读|2 个评论 热度 4

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