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日志

分享 MAX5开发板
2012-1-17 08:20
看见博客可以上传附件,就把关于MAX5的几篇文章上传到附件中。 对不起啊,发现没有上传.原来是自己不会上传,郁闷
个人分类: quartus|794 次阅读|0 个评论
分享 MAX5开发板
2012-1-16 11:59
前一段时间使用了MAX5开发板,总体上的感觉很好,收获蛮大的,可以博客不能复制粘贴,因为不能把文章贴到博客上,为了记忆方便,我的MAX5开发板的文档为 电子创新网-shiyijita
个人分类: quartus|710 次阅读|0 个评论
分享 MAX5开发板-笔记
2012-1-16 11:55
0 踩 0 在调试触摸电容的时候,发现。 1 : 采用明信片,发现灯不亮 2 : 采用刀片 ,不管横放,还是竖放,当到一定距离后,灯光都会亮 3 : 采用普通的中性笔。放入传感区的时候,先亮后灭。 4 ...
个人分类: quartus|3076 次阅读|0 个评论
分享 关于分组约束的使用?
2012-1-12 16:56
前几天在调试DA的时候,因为要3个DA进行串联,所以要串行发送24位数据,此时会遇到问题 “有的DA档位会出错” ,这个问题,当时考虑是时序达不到,后来把DA的时序降低到5M,但是发现偶尔还是出错。 因此想到 是不是24的寄存器进行串行输出的时候,是不是有的位数因为离着时钟比较远,导致数据在时钟后面,基于这个思路,把2 ...
个人分类: xilinx|780 次阅读|0 个评论
分享 ucf的简单语法
2012-1-12 16:45
因为最近在忙着弄建立,就没有时间写博客,今天抽出点时间来更新一下 关于ucf的语法 1 : 最基本的语法 NET “a0” IOSTANDARD = “LVCMOS33” ; NET “a0” LOC = “v1” ; 这是设置引脚和电压的文档 2 : 设置频率 NET “a0” TNM_NET = a ; TIMESPEC TS_a = period " ...
个人分类: xilinx|2210 次阅读|0 个评论
分享 altera-modelsim后仿真
2011-12-29 16:11
上周才搞定时序仿真,唉,以前都用功能仿真。 时序仿真的方法,是 1 : 进行功能仿真,其实也可以不进行功能仿真,但是必须保证tesebench正确。 2: 功能程序用。vo代替。 3: 从qurtus中调用altera-modelsim,新建一个library,同时把要仿真的。vo和产生的sdo文件,以及testbench放入新建的库中, 4:进入ltera-eda-sim ...
个人分类: quartus|1123 次阅读|0 个评论
分享 异步复位和同步复位的关系
2011-12-29 16:05
最近在和同事讨论异步复位和同步复位的时候,发现自己对于综合后的概念好模糊,唉,实际上,异步复位的时候,是异步信号走的clr信号,这个信号通过一个非门连接到了第二个RS锁存器,或者是第二个D锁存器的非门,这样就构成了异步操作,但是异步操作一般是通过同步锁存,异步复位的方式来产生的,这样的优势可以节省资源,同 ...
个人分类: verilog/vhdl|1146 次阅读|0 个评论
分享 职场语言 我们 /咱们
2011-12-19 12:57
唉,这两天被前辈提携了一下,就是关于我们和咱们 这两个字,虽然只有一字之差,但是境界确实千差万别,用 咱们 表示 我和你 ,用我们表示我,下次注意了!!
个人分类: 职场|774 次阅读|2 个评论
分享 状态机
2011-12-14 19:36
最近在调试高频时序,时钟是250m,采用了三段式状态机的写法,本来这个写法也没有问题,而且timequest也没有报错,但是时序就是一直达不到,后来我经过测试,发现状态机在某一个状态下跑飞了,刚开始的时候怕丢失了敏感信号,就把程序改为always @(×) 结果没有效果,后来把程序改为了always@(posedge clk),此时发现工 ...
个人分类: verilog/vhdl|927 次阅读|1 个评论
分享 Altera特殊管脚的使用【转】
2011-12-12 10:12
Altera特殊管脚的使用(适用全系列Altera FPGA,MSEL区别除外)-来自altera论坛 1.I/O, ASDO 在 AS 模式下是专用输出脚,在 PS 和 JTAG 模式下可以当 I/O 脚来用。在 AS 模式下,这个脚是 CII 向串行配置芯片发送控制信号的脚。也是用来从配置芯片中读配置数据的脚。在 AS 模式下 ...
个人分类: quartus|7623 次阅读|0 个评论
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