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EETOP 创芯网论坛 (原名：电子顶级开发网) › 日志

日志

分享复位设计: Hermin 2021-7-31 15:16; 一、异步复位释放时，与时钟不满足set up 和hold 同样会引发亚稳态问题：带异步复位端的D触发器，电路有两级组成。前一级主要实现电路的保持，前一级的输出为沿变时捕获的值。后一级为数据的输出。 1. 异步复位信号有效时，直接驱 ...; 2211 次阅读|0 个评论热度 11

分享 2021-07-31: Hermin 2021-7-31 11:27; 时钟作为FPGA心脏，求稳求准。I. 利用器件的延时产生时钟，例如晶振；II. 铯原子自振钟；III. VCO压控振荡器，例PLL（PLL对输入输出时钟有范围限制）Q1：对低速时钟的2^n分频； 1.二分频，打一拍；但是不可以用二分频 ...; 325 次阅读|0 个评论

分享 modelsim仿真lattice IP的bug: Hermin 2021-7-6 18:13; modelsim 貌似自10.7之后的版本都有这样的问题：遇到 -novopt 就 ERROR All optimizations are disabled because the -novopt option is in effect. This will cause your simulation to run very slowly. If you are using this switch to preserve visibility for Debug or PLI features, please see ...; 2387 次阅读|0 个评论热度 10

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