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日志

分享 DFT还是要依托于设计
2019-9-8 09:24
提到DFT(Design for test)大家都能随口而出它到底指的是什么,包括JTAG/SCAN/ATPG/MBIST这些东西之类的,由于DFT中设计很多跟网表以及后端相关的东西,目前在使用主流flow的很多大公司中DFT组都是跟后端组放在一块的,这样方便项目数据的获取和沟通,很多人就存在一个固话影响,那就是DFT只要跟后端一样跑跑flow然后递交 ...
个人分类: DFT|717 次阅读|0 个评论
分享 验证学习
2018-10-8 00:14
最近在学习system verilog和uvm验证相关的知识,因为目前项目中会遇到各种跟功能验证相关的知识,而我们组又没有人懂这个东西,没办法只能自己搞了,谁让当初在领导面前夸下海口想更加深入地学习flow和env相关的东西,只有硬着头皮学了。可以说我是连verilog的验证平台都没咋弄过,当时 ...
1403 次阅读|1 个评论
分享 关于学习
2018-8-8 07:59
这两年国家要大力投资芯片产业,特别是前一阵中兴被制裁事件的爆发,导致很多热钱涌入这个行业,甚至各大互联网公司都开始要做芯片,这样导致的一个结果就是各种IC教育培训的兴起,很多干了几年集成电路的工程师拉上几个人就可以搞一个看上去还挺高大上的培训,总之都可以打着振兴国家集成电路 ...
1021 次阅读|0 个评论
分享 一个perl小脚本小结
2018-7-19 00:09
今天在工作中遇到一个问题,concept答应release的mbist的svf格式改了,原来那个用来将svf转成xml格式的测试用例的方法不再试用,没辙只能自己写脚本了,首先把思路理清楚,我需要做的是从输入的svf中抓出相应的pin的方向和名字,以及每一条指令中给各个pin所设置的值,然后把整个文件中所有这种给激励的命令 ...
个人分类: 脚本|1575 次阅读|0 个评论
分享 Gatesim timing issue
2017-7-31 21:38
好久没更新过日志了,最近工作比前一阵稍微忙了一些。 上周在clean gatesim的testcase仿真的时候遇到一个这样的问题:在ddr的一条idv chain里面有一层hierarchy中有一个buffer的延时特别大,默认貌似为9999ns,因为这个huge delay的buffer直接把idv cell里面的时钟 ...
1595 次阅读|0 个评论
分享 继续记录
2017-7-7 12:10
一年的dft验证工作,好像回到了原点,坚持…
707 次阅读|0 个评论
分享 开始自己的技术日志
2016-3-5 03:32
从今天开始记录自己的学习和工作总结,给自己开一个好头,今天晚上强迫着自己将8051那个项目又重新过了一遍,把后端大体的flow大致跑了一下,太久没有实践和反思了,从年前十二月份到现在三个月的时间过得浑浑噩噩的,前天痛下决心删游戏,戒烟戒酒,开始泡论坛学东西,坚持锻炼身体,今天在跑flow的 ...
908 次阅读|0 个评论
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