% EE 536: Phase-Locked Loops % % Matlab code for estimating total PLL phase noise % Thanks to Aniruddhan Sankaran for providing the basis for this code % function Phase_Noise(PN_pcl, PN_vco, PN_div) % % PN_div - divider phase noise profile (from Cadence) % PN_pcl - PFD/CP/LPF amplitude noise pr ...
图示:
==路上,晨听基辛格发言,这老头挺智慧== 这老头就表达了几点: 1,目前状态如第一次世界大战前,大家迷茫,无法妥协。 2,中美关系,影响世界命运。人工智能,留给人类的只有5~10年时间了。所以基辛格说中美关系只有5~10年来解决了.... 这老头留了半句话没说... 潜台词就是: 谁能最先搞定AGI....如果美国现在搞 ...
我从2019年开始接触sdm adc,刚开始做audio,后来做transceiver。在做收发机之后我系统学习了sdm的理论,介绍一些书给想要深入研究sdm adc的朋友。 第一本:《Understanding Delta-Sigma Data Converters, 2nd edition 》,我是以这本为主干进行学习的,这个书的一个作者RIC ...
我研究这个问题,起源于我对sdm ntf的zero pole物理意义的思考 比如我用delsig工具包综合出来两组dt的sdm ntf,零极点我也plot出来了,那么我如何分析这两个ntf函数呢? 为何z域只在单位圆上进行分析,而零极点却可以不在单位圆上? 这里面有 ...
两级运放外加反馈电容(常称为肩膀电容),稳定性应该如何分析呢? 我以前有个错误观念,认为cf越大,运放第二级gm2就需要越大,因为根据米勒等效cf等效到输入(1+A)*cf,等效到输出cf。 错在哪里了? 我的错误在于分析环路(ntf)时,不应该“拆环”, ...
-------------------------------自用--------------------------- TAPEOUT(TO):流片,指提交最终GDSII文件给Foundry工厂做加工。 MPW :多项目晶圆,将多个使用相同工艺的集成电路设计放在同一晶圆片上流片,制造完成后,每个设计可以得到数十片芯片样品。 FULL MASK :“全掩膜”的意思,即制造流程中的全部 ...
在matlab的程序编写中,我是经常犯这样的错误。因为矩阵维度的原因,要用点乘代替矩阵乘法,所以要改成加点的乘号或除号。 如果公式很长很多,一个个改起来很麻烦,虽然有出错行提示,但依旧要不少时间。这个时候要想快速知道结果,有个暂时的解决办法: 采用循环语句,一个点一个点的去算,然后对出来的结果进 ...
Accessing Lists Lists are stored internally as a series of branching decision points. Think of the left branch as pointing to the first element and the right branch as pointing to the rest of the list (further branch decision points). The car function follows the left branch and the cdr func ...
vdssat与vgs-vth有何关系? 我常用Vod(vgs-vth)来表示过驱动电压,那么vdssat和vod在bsim3、bsim4、bsim6里面是怎么定义的呢? bsim里统一这样定义:(vdssat=vdsat-vs,vs一般是0),一般Abulk≈1,那么Vdssat是Esat*Leff和Vod的“并联”。 我仿真了一张Vdsat和vod的图 可以看出两者在150mv处交汇,之 ...
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